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部品型式

EPM9320RC208-15

製品説明
仕様・特性

® Includes MAX 9000A MAX 9000 Programmable Logic Device Family November 2001, ver. 6.3 Features... Data Sheet ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ ■ High-performance CMOS EEPROM-based programmable logic devices (PLDs) built on third-generation Multiple Array MatriX (MAX®) architecture 5.0-V in-system programmability (ISP) through built-in IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface Built-in JTAG boundary-scan test (BST) circuitry compliant with IEEE Std. 1149.1-1990 High-density erasable programmable logic device (EPLD) family ranging from 6,000 to 12,000 usable gates (see Table 1) 10-ns pin-to-pin logic delays with counter frequencies of up to 144 MHz Fully compliant with the peripheral component interconnect Special Interest Group’s (PCI SIG) PCI Local Bus Specification, Revision 2.2 Dual-output macrocell for independent use of combinatorial and registered logic FastTrack® Interconnect for fast, predictable interconnect delays Input/output registers with clear and clock enable on all I/O pins Programmable output slew-rate control to reduce switching noise MultiVolt™ I/O interface operation, allowing devices to interface with 3.3-V and 5.0-V devices Configurable expander product-term distribution allowing up to 32 product terms per macrocell Programmable power-saving mode for more than 50% power reduction in each macrocell Table 1. MAX 9000 Device Features Feature Usable gates EPM9320 EPM9320A EPM9400 EPM9480 EPM9560 EPM9560A 6,000 8,000 10,000 12,000 Flipflops 484 580 676 772 Macrocells 320 400 480 560 Logic array blocks (LABs) 20 25 30 35 Maximum user I/O pins 168 159 175 216 tPD1 (ns) 10 15 10 10 tFSU (ns) 3.0 5 3.0 3.0 tFCO (ns) 4.5 7 4.8 4.8 fCNT (MHz) 144 118 144 144 Altera Corporation A-DS-M9000-6.3 1

ブランド

ALTERA

現況

米半導体大手インテル(INTC.O)は1日、米アルテラALTR.Oを167億ドルで買収することで合意したと発表した。

会社名

Altera Corporation

本社国名

U.S.A

事業概要

SigneticsやMMIに続くプログラマブルロジックのパイオニア的企業の一つである。システムオンプログラマブルチップを可能にするべく、様々な技術を開発。最近の例では、チップ中にメモリやマイクロプロセッサ、トランシーバを埋め込んだものもある。

供給状況

 
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